做電路設計，需要提前用理想模型如VerilogA模型做驗證。這里分享一個由ahdlib庫里單端opamp改造而來的差分opamp。參考何樂年的《模擬集成電路設計與仿真》10.4節423頁；
描述的小信號模型如上。
VerilogA 用到了SR=I/C，GBW=gm/C,gain=gm*r1等概念。加了內部節點cout_p,coutn作為描述對象，很巧妙。
差分OPA verilogaA 模型
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