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?要滿足復位恢復時間才能正常復位，不然會產生輸出準穩態，輸出邏輯錯誤
?復位恢復時間只會存在復位釋放時刻，不會出現在確立時刻，則不推薦完全異步復位
?完全同步復位，肯定是同步于時鐘滴，并將總是滿足時鐘條件，
?但是在慢時鐘的時候可能會產生復位丟失，也就相當于確立不了復位，用異步確立，同步釋放來解決
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?推薦為系統復位
兩個時鐘達到后面
FPGA應用學習筆記------系統復位一（同異復位）
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