module ADDER（
input [5：0]A，
input [5：0]B，output[6：0]Q
）；
assign Q= A+B；endmodule
綜合結果如下圖所示：?
? ? ? ? 使用了6個Lut，，6個LUT分布在豎直的兩個Slice中
?
因此當一個CLB里面的LUT不足以完成加法運算的時候，通過進位鏈邏輯電路，可以實現多個Sclice級聯完
?
FPGA之帶有進位邏輯的加法運算
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